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  • Cadence仿真,NMOS管的漏端輸出電阻介紹
    • 發(fā)布時(shí)間:2023-01-31 15:24:03
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    Cadence仿真,NMOS管的漏端輸出電阻介紹
    NMOS管的漏端輸出電阻
    nmos管的輸出電阻可以將柵端接地,在漏端加一個(gè)直流電壓,測量Id ,然后作兩者之間的比值即為漏端輸出電阻。
    NMOS管 輸出電阻 仿真
    做DC直流仿真,然后在ADE界面中執(zhí)行菜單欄命令【Tools】→【Results Browser】,選擇mos管,將id取值到計(jì)算器當(dāng)中:
    NMOS管 輸出電阻 仿真
    同樣的,將漏級電壓源的電壓值也取值到計(jì)算器當(dāng)中:
    NMOS管 輸出電阻 仿真
    接下來,在ADE界面中執(zhí)行菜單欄【Outputs】→【Setup】,添加新的公式,取名為Rout,獲取計(jì)算器中的公式:
    NMOS管 輸出電阻 仿真
    最后的ADE界面如下:
    NMOS管 輸出電阻 仿真
    對VDD進(jìn)行參數(shù)掃描,注意不要在DC掃描中設(shè)置。
    最后得到的輸出阻抗的曲線為:
    NMOS管 輸出電阻 仿真
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